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DI-GATE-V

Hochoptimierte Open-Source-RISC-V-Prozessoren für universelle Anwendungen

DI-GATE-V entwickelt hochoptimierte quelloffene RISC-V-Prozessorkerne für allgemeine Anwendungen. Die offene RISC-V-Architektur bildet die Grundlage für souveräne und nachvollziehbare Prozessorentwicklung.

Ziele und Vorgehen

Im Vorhaben wird eine neue RISC-V-Prozessorfamilie für den Edge- und Embedded-Bereich entwickelt und vollständig quelloffen bereitgestellt. Begleitend entstehen Werkzeuge, die die einfache Anpassung, Optimierung und Synthese der Prozessoren für verschiedene Anwendungsfälle und Hardwareplattformen ermöglichen.

Innovationen und Perspektiven

Synthesewerkzeuge für FPGAs sind häufig sperrig und nur nach kostenpflichtiger Registrierung nutzbar. Moderne, quelloffene Alternativen reduzieren die Zugangshürden für junge Talente und verbessern Flexibilität, Interoperabilität und Effizienz der Entwurfsketten.

Verbundkoordinator

Verbundpartner

Dieses Projekt wird vom Bundesministerium für Forschung, Technologie und Raumfahrt (BMFTR) im Rahmen der Designinitiative Mikroelektronik gefördert.

Veranstaltungen

© IEEE PRIME Conference
20. Sept. 2026 - 23. Sept. 2026
Berlin

PRIME 2026

21st International Conference on PhD Research in Microelectronics and Electronics

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SMACD 2026

International Conference on Synthesis, Modeling, Analysis and Simulation Methods, and Applications to Circuit Design

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20. Juni 2026 - 28. Juni 2026
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IdeenExpo 2026

Europas größtes Jugendevent für Technik und Naturwissenschaften

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19. Juni 2026
Dresden

bits, bonding, bassline

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19. Mai 2026 - 20. Mai 2026
Baden-Baden

microTEC Clusterkonferenz 2026

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6. Mai 2026 - 7. Mai 2026
Dresden

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20. Apr. 2026 - 22. Apr. 2026
Verona

DATE 26 conference

Design, Automation and Test in Europe Conference

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